AD9510BCPZ

AD9510 est un circuit intégré de distribution d'horloge à sorties multiples avec un noyau de boucle à verrouillage de phase (PLL) sur puce. La conception met l'accent sur la faible gigue et le bruit de phase pour optimiser les performances du convertisseur de données. D'autres applications avec des exigences élevées en matière de bruit de phase et de gigue bénéficient également de ce composant La section PLL se compose d'un diviseur de référence programmable (R); un détecteur de fréquence de phase (PFD) à faible bruit ; une pompe de charge de précision (CP); et un diviseur de rétroaction programmable (N). En connectant un oscillateur à quartz commandé en tension externe (VCXO) ou un oscillateur commandé en tension (VCO) aux broches CLK2 et CLK2B, des fréquences allant jusqu'à 1,6 GHz peuvent être synchronisées avec la référence d'entrée. L'application comprend une distribution d'horloge à faible gigue et à faible bruit de phase cadençant des ADC, des DAC, des DDS, des DDC, des DUC et des frontaux à signaux mixtes (MxFE) à grande vitesse, des émetteurs-récepteurs sans fil hautes performances, une instrumentation hautes performances et une infrastructure à large bande.

• Faible bruit de phase, boucle à verrouillage de phase
• Prédiviseur programmable à double module
• Courant de la pompe de charge programmable
• Sélection de phase pour le réglage grossier du retard de sortie à sortie
• Port de contrôle série
• Gamme de fréquence d'entrée 0 à 250MHz (VS = 3.3V, ±5%, VS ≤ VCPS ≤ 5.5V, TA = 25°C)
• Sensibilité d'entrée typique de 150mV p-p (VS = 3,3V ±5 %, VS ≤ VCPS ≤ 5,5V, TA = 25°C)
• Température d'utilisation de -40 à +85°C
• Boîtier Lead Frame Chip Scale [LFCSP-VQ], 64 broches

Remarques

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